在VHDL的FOR_LOOP语句中的循环变量是一个临时变量,属于LOOP语句的局部量,()事先声明。
- A必须
- B不必
- C其类型要
- D其属性要
在VHDL的FOR_LOOP语句中的循环变量是一个临时变量,属于LOOP语句的局部量,()事先声明。
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在VHDL语言中,ARCHITECTURE中的语句都是()执行的语句。A顺序B并行C即可顺序也可并行D无法确定
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在利用变量进行编程时,程序段WHILE[#2LE#5]D02为循环判断语句。A正确B错误
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在VHDL的CASE语句中,条件句中的“=>”不是操作符号,它只相当与()作用。AIFBTHENCANDDOR